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3.6.1 PWM frequency
The PWM speed for the PWM is programmed to the maximum (64MHz). The source
clock is the PLL output (96MHz) used both by USB and PWM.
A postscaler offers a 1.5 division for the PLL signal: 96MHz/1.5 = 64MHz (see
PLLTM1 and PLLTM0 in PLLFREQ register).
The result on the PWM output signal is a 250kHz frequency:
64MHz / 256 = 250kHz
Where 256 is the size in bit of the in OCR4A compare register used in Timer 4.
Figure 3-2. PWM output signal.
PWM
output
t on
t off
t
The software controls the battery voltage/current in modifying the duty cycle of PWM
output. If ton increases, the battery voltage/current receives a more important energy
load.
10
AVR146
7801A-AVR-06/08
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